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SoC Debug System IC Designer

英文職缺・已幫你整理成中文

  • 台北
  • 初階
  • 3/29 刊登

職缺摘要

聯發科招募台北的 SoC Debug System IC Designer，負責 SoC 偵錯模組的設計、RTL 實作、整合與驗證，並支援除錯流程與跨部門協作。

摘要由 AI 依英文原文整理成中文，不是逐字翻譯，以官方職缺為準

職缺內容

工作內容

  • SoC 偵錯模組的設計與 RTL 實作
  • SoC 平台的除錯訊號擷取、追蹤與分析
  • BUS 架構與除錯機制電路設計
  • 支援 SoC 除錯流程與問題定位
  • 與跨功能團隊合作以最佳化除錯效能

必備條件

  • 學歷要求：碩士
  • 科系要求：資科/資工、電控/控制、通訊/電信、電機/電子相關科系
  • 工作經驗：無工作經驗可

由英文原文整理成中文的重點，不是逐字翻譯。 看原始職缺的完整內容

技能

  • RTL 設計

時間軸

  1. 官方刊登

    2026-03-29（來源提供）・187 天前

  2. 第一次在官方頁發現

    追蹤開始前已刊登

  3. 最後一次確認仍在官方頁

    2026-10-02 11:18・58 分鐘前

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