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類比射頻積體電路佈局設計(高速類比SerDes電路)

  • 新竹
  • 初階
  • 4/27 刊登

職缺摘要

負責聯發科高速類比SerDes電路之全客製化佈局設計及自動化流程設計。

摘要由 AI 依官方職缺內容整理，以官方職缺為準

中文重點整理

工作內容

  • 高速類比SerDes電路全客製化佈局設計
  • 自動化流程設計

必備條件

  • 兩年以上工作經驗
  • 大學學歷，科系要求包含電控/控制、通訊/電信、電機/電子、物理、資科/資工等相關領域

依官方職缺內文整理的重點，不是原文。 看原始職缺的完整內容

技能

  • IC Layout

時間軸

  1. 官方刊登

    2026-04-27（來源提供）・158 天前

  2. 第一次在官方頁發現

    追蹤開始前已刊登

  3. 最後一次確認仍在官方頁

    2026-10-02 10:17・1 小時前

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