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Senior Staff Engineer, Hardware & Silicon Validation

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  • TW - Hsinchu
  • 資深
  • 3 小時前發現

職缺摘要AI 整理

負責 Marvell 自研 IP 之 PCIe 與 Ethernet PHY 後矽晶片驗證，包含晶片開機測試、高速訊號量測分析、自動化測試開發與跨部門除錯協作。

職缺內容

AI 整理

工作內容

  • 全面負責後矽晶片環境下 PCIe/Ethernet PHY 驗證計畫的制定、執行與報告
  • 執行實驗室晶片開機與單元測試，涵蓋實體層、PCS 層韌硬體功能及 PCIe 協定層
  • 使用示波器、BERT 等設備量測眼圖、Jitter 及 BER，進行高速訊號驗證與分析
  • 運用診斷工具與硬體分析儀排查測試問題，並主導跨部門技術討論以解決問題
  • 與跨部門團隊及客戶協作，排查並除錯與 PHY 相關的設計問題及不良案例

必備條件

  • 電機工程學士具 8-10 年相關經驗，或碩士具 6-8 年矽晶片驗證/壓力/PVT 測試經驗
  • 具備 8-10 年高速 IO 測試、除錯與驗證經驗，熟高速 SERDES 與 PCIe 協定
  • 具備優秀的實驗室動手實作、系統開機(bring up)與除錯經驗
  • 熟悉 SERDES 特性量測設備（示波器、BERT、網路分析儀等）操作
  • 具備良好的英文書寫與口語溝通能力，並具備 Python 或 Matlab 自動化腳本開發能力

加分條件

  • 熟悉常見高速介面之實體層與協定層(PIPE I/F、PCS、MAC)知識者尤佳
  • 具備電路板設計知識，能看懂電路原理圖(schematics)與 PCB 佈局
  • 具備 SERDES 建模技術相關知識

看原始職缺的完整內容

技能

  • Python
  • 硬體除錯

時間軸

  1. 官方刊登

    2026-10-20（來源提供）・2 天前

  2. 第一次在官方頁發現

    2026-10-22 23:23・3 小時前

  3. 最後一次確認仍在官方頁

    2026-10-23 02:23・53 分鐘前

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